LSIの論理設計・検証エンジニア/Verilogを用いたRTL設計および最新EDAツールによる検証/115226 - 東京都 立川市

登録メンバーのみ 東京都 立川市, 日本

2週間前

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仕事内容: · 半導体デバイスの論理設計フェーズにおける仕様検討からRTL設計、 · EDAツールを用いた検証、実機評価まで幅広く携わります。 · 主力製品に搭載される複雑な機能を回路として具現化し、 · シミュレーションを通じて設計品質を担保していく非常に重要な役割です。 · 具体的には、Verilog HDLを用いたコーディングを行い、 · Synopsys VCSやCadence Xceliumなどの業界標準ツールで機能検証を進めます。 · SystemVerilogアサーションを用いた高度な検証や、Python/Perlによる検証環境の自動化、 ...
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